专利摘要
一种在主面侧形成了具有半导体集成电路的多个半导体晶片的半导体基板上对被切割了的半导体晶片进行积层，在不同层的半导体晶片之间以可传递信号的方式进行连接，之后，对被积层了的所述半导体晶片部分进行切割的半导体装置的制造方法，其具有：第1步骤，在所述半导体基板的所述主面上形成绝缘层；第2步骤，将主面侧具有半导体集成电路的被切割了半导体晶片，以使与所述主面相反侧的面面对所述绝缘层并介由所述绝缘层的方式，在所述半导体基板上所形成的半导体晶片上进行积层；及第3步骤，形成可使不同层的半导体晶片之间进行信号传递的连接部。
权利要求
1.一种半导体装置的制造方法，在主面侧形成了具有半导体集成电路的多个半导体晶片的半导体基板上对被划片了的半导体晶片进行积层，在不同层的半导体晶片之间以可传递信号的方式进行连接，之后，对被积层了的所述半导体晶片的部分进行划片，所述制造方法的特征在于，具有：
第1步骤，在所述半导体基板的所述主面上形成绝缘层；
第2步骤，将主面侧具有半导体集成电路的被划片了的半导体晶片，以使与所述主面相反侧的面面对所述绝缘层并介由所述绝缘层的方式，在所述半导体基板上所形成的半导体晶片上进行积层；及
第3步骤，形成可使不同层的半导体晶片进行信号传递的连接部。
2.根据权利要求1所述的半导体装置的制造方法，其特征在于，
在所述第3步骤中，形成贯穿所述被划片了的半导体晶片的导通孔，
介由所述导通孔，形成可使不同层的半导体晶片进行信号传递的连接部。
3.根据权利要求1所述的半导体装置的制造方法，其特征在于，
在所述第3步骤之前具有第4步骤，形成对所述被划片了的半导体晶片的至少侧面的一部分进行密封的密封绝缘层，
在所述第3步骤中，形成贯穿所述密封绝缘层的第2导通孔，介由所述第2导通孔，形成可使不同层的半导体晶片进行信号传递的连接部。
4.根据权利要求1所述的半导体装置的制造方法，其特征在于，
在所述第3步骤之前具有第4步骤，形成对所述被划片了的半导体晶片的至少侧面的一部分进行密封的密封绝缘层，
在所述第3步骤中，形成贯穿所述被划片了的半导体晶片的导通孔，并形成贯穿所述密封绝缘层的第2导通孔，介由所述导通孔及所述第2导通孔，形成可使不同层的半导体晶片进行信号传递的连接部。
5.根据权利要求1所述的半导体装置的制造方法，其特征在于，
在所述第2步骤中，代替所述被划片了的半导体晶片，将由多个被划片了的半导体晶片所积层了的积层体，以使与所述主面相反侧的面面对所述绝缘层并介由所述绝缘层的方式，在所述半导体基板上所形成的半导体晶片上进行积层。
6.根据权利要求5所述的半导体装置的制造方法，其特征在于，
在所述第2步骤之前具有第5步骤，对在主面侧形成了具有半导体集成电路的多个半导体晶片的半导体基板进行积层，在构成不同层的所述半导体基板的所述半导体晶片之间以可传递信号的方式进行连接，之后，对所述半导体晶片的部分进行划片以形成所述积层体。
7.根据权利要求6所述的半导体装置的制造方法，其特征在于，
所述第5步骤具有：
准备第1半导体基板及第2半导体基板的步骤；
对所述第2半导体基板进行薄型化的步骤；
将被薄型化了的所述第2半导体基板的与主面相反侧的面介由绝缘层固定至所述第1半导体基板的主面的步骤；
在被薄型化了的所述第2半导体基板上形成从所述第2半导体基板的主面贯穿至与主面相反侧的面的导通孔的步骤；
介由所述导通孔，形成可使所述第1半导体基板的所述半导体晶片和所述第2半导体基板的所述半导体晶片之间进行信号传递的连接部的步骤；及
对所述半导体晶片的部分进行划片的步骤。
8.根据权利要求1所述的半导体装置的制造方法，其特征在于，
在所述第2步骤中，将功能或形状分别不同的半导体晶片介由所述绝缘层在所述半导体基板上所形成的半导体晶片上进行积层。
9.根据权利要求1所述的半导体装置的制造方法，其特征在于，
在被积层了的每个所述半导体晶片中，与不同层的半导体晶片相连接的每个配线被分配了数量与被积层的半导体晶片的数量相对应的电极垫，
每个所述电极垫与对应的所述连接部相连接，
所述电极垫的一部分不与任何所述配线相连接。
10.根据权利要求1所述的半导体装置的制造方法，其特征在于，具有：
所述第3步骤之前的第4步骤，形成对所述被划片了的半导体晶片的至少侧面的一部分进行密封的密封绝缘层；
所述第3步骤之后的第6步骤，在所述被划片了的半导体晶片上形成第2绝缘层；
第7步骤，准备在主面侧具有半导体集成电路的被划片了的其它半导体晶片，以使与所述主面相反侧的面面对所述第2绝缘层并介由所述第2绝缘层的方式，在所述被划片了的半导体晶片上进行积层；及
第8步骤，形成可使所述被划片了的其它半导体晶片和所述被划片了的半导体晶片之间进行信号传递的连接部。
11.根据权利要求1所述的半导体装置的制造方法，其特征在于，
所述第3步骤之前具有第4步骤，形成对所述被划片了的半导体晶片的至少侧面的一部分进行密封的密封绝缘层，
所述第4步骤是，在所述第2步骤之后，形成对所述被划片了的半导体晶片的至少侧面进行密封的密封绝缘层的步骤。
12.根据权利要求1所述的半导体装置的制造方法，其特征在于，
在所述第3步骤之前具有第4步骤，形成对所述被划片了的半导体晶片的至少侧面的一部分进行密封的密封绝缘层，
所述第4步骤是，在所述第2步骤之后，在所述绝缘层的外缘部设置围绕所述被划片了的半导体晶片的框体部件，并在所述框体部件和所述被划片了的半导体晶片所形成的间隙内填充树脂，以形成对所述被划片了的半导体晶片的至少侧面进行密封的密封绝缘层的步骤。
13.根据权利要求1所述的半导体装置的制造方法，其特征在于，
在所述第3步骤之前具有第4步骤，形成对所述被划片了的半导体晶片的至少侧面的一部分进行密封的密封绝缘层，
所述第4步骤包含：
在所述第2步骤之前，将所述被划片了的半导体晶片的所述主面介由黏接层临时固定在支持体上的步骤；及
形成对被临时固定在所述支持体上的所述被划片了的半导体晶片的至少所述侧面的一部分进行密封的密封绝缘层的步骤，
所述第2步骤包含：
以使与从所述密封绝缘层露出的所述主面相反侧的面面对所述绝缘层并介由所述绝缘层的方式，在所述半导体基板上所形成的半导体晶片上进行积层的步骤；及
对所述黏接层及所述支持体进行去除的步骤。
14.根据权利要求10所述的半导体装置的制造方法，其特征在于，具有：
第9步骤，对所述半导体基板、所述被划片了的半导体晶片、及所述被划片了的其它半导体晶片的至少1个进行薄型化。
15.根据权利要求1所述的半导体装置的制造方法，其特征在于，
所述半导体基板在平面视图中为大致圆形形状。
16.根据权利要求1所述的半导体装置的制造方法，其特征在于，
所述连接部通过电气信号对不同层的半导体晶片进行连接。
17.根据权利要求1所述的半导体装置的制造方法，其特征在于，
所述连接部通过光信号对不同层的半导体晶片进行连接。
18.根据权利要求1所述的半导体装置的制造方法，其特征在于，
被积层了的所述半导体晶片的一部分中包含与所述半导体晶片绝缘了的、不具有半导体晶片的结构层。
19.根据权利要求18所述的半导体装置的制造方法，其特征在于，
所述结构层为基板、金属层、或绝缘层。
20.根据权利要求18所述的半导体装置的制造方法，其特征在于，
所述结构层具有对所述半导体晶片进行冷却的功能。
21.根据权利要求18所述的半导体装置的制造方法，其特征在于，
所述结构层具有MEMS。
22.根据权利要求14所述的半导体装置的制造方法，其特征在于，
所述第9步骤中被薄型化了的一部分的所述半导体基板、所述被划片了的半导体晶片、或所述被划片了的其它半导体晶片的厚度为分别具有所述半导体基板、所述被划片了的半导体晶片、或所述被划片了的其它半导体晶片的装置的元件分离深度的5倍以上。
23.根据权利要求14所述的半导体装置的制造方法，其特征在于，
所述第9步骤中被薄型化了的一部分的所述半导体基板、所述被划片了的半导体晶片、或所述被划片了的其它半导体晶片的厚度为1μm以上。
24.根据权利要求1所述的半导体装置的制造方法，其特征在于，
在所述第3步骤中，形成纵横比为0.5以上5以下的导通孔，并在所述导通孔内形成所述连接部。
说明书
技术领域
本发明涉及一种半导体装置的制造方法，尤其涉及一种在包含半导体晶片的半导体基板上对被划片了的半导体晶片进行积层，在不同层的半导体晶片之间以可传递信号的方式进行连接，之后，对被积层了的所述半导体晶片的部分进行划片的半导体装置的制造方法。
背景技术
近年，半导体应用产品作为数码相机和手机等各种移动机器的用途等正在急剧趋于小型化、薄型化、及轻量化。同时，就半导体应用产品上所安装的半导体装置而言，也存在着小型化和高密度化的要求，为了响应该要求，例如，提出了一种在晶圆（Wafer）状态的半导体晶片（Chip）上直接对其它半导体晶片进行积层的所谓的“晶片堆叠晶圆”（以下称“COW”）技术。
[现有技术文献]
[专利文献]
[专利文献1]（日本）特开2010－278279号公报
发明内容
[发明要解决的课题]
但是，在现有的COW技术中，使用了一种预先埋设纵横比较大的连接孔（TSV）并形成凸点或金属突起，再对半导体晶片进行接合，或者，使半导体晶片的装置面（形成了半导体集成电路的面）合在一起后，再进行薄型化并由连接孔（TSV）进行接合的方法。
为此，在前者的情况下，对半导体晶片进行接合时，因为需要在从双方的半导体晶片所露出的导通孔内形成凸点或金属突起的步骤，所以存在着生产率较低，半导体装置的制造成本上升的问题。另外，在后者的情况下，因为采用使装置面相对的方式来进行半导体晶片的接合，所以需要具有预先进行了设计的配线，并且，由于用于连接的连接配线的柔软性较低，如果单纯地重复进行同样的步骤，则不能对3个以上的半导体晶片进行积层。即，因为对3个以上的半导体晶片进行积层时需要特别的步骤，所以存在着生产率较低，半导体装置的制造成本上升的问题。
另外，不论在前者还是后者的情况下，当形成较深的导通孔时，因为导通孔的孔加工和金属填充的时间较长，另外还需要增加必要的材料，所以都存在着半导体装置的制造成本上升的问题。
另外，不论在前者还是后者的情况下，通过干蚀刻（Dry Etching）等形成导通孔时，导通孔的大小和密度随着深度的不同而不同，导致导通孔前端部分的直径发生变化。其结果为，因为当将半导体晶片薄型化至预期的厚度时所露出的导通孔的直径并不相同，所以存在着电连接时电阻值不均、可靠性下降的问题。
本发明是鉴于上述问题而提出的，其目的在于提供一种可靠性和生产率较高，并可降低制造成本的半导体装置的制造方法。
[用于解决课题的手段]
为了实现上述目的，本发明是一种在主面侧形成了多个（本文中，多个指“2个以上”）具有半导体集成电路的半导体晶片的半导体基板上对被划片了的半导体晶片进行积层，在不同层的半导体晶片之间以可传递信号的方式进行连接，之后，对被积层了的所述半导体晶片的部分进行划片的半导体装置的制造方法，其特征在于，具有：第1步骤，在所述半导体基板的所述主面上形成绝缘层；第2步骤，将主面侧具有半导体集成电路的被划片了的半导体晶片，以使与所述主面相反侧的面面对（对着）所述绝缘层并介由所述绝缘层的方式，在所述半导体基板上所形成的半导体晶片上进行积层；及第3步骤，形成可使不同层的半导体晶片进行信号传递的连接部。
[发明的效果]
根据本发明，能够提供一种可靠性和生产率较高，并可降低制造成本的半导体装置的制造方法。
附图说明
图1是对第1实施方式的半导体装置进行例示的截面图。
图2A是对第1实施方式的半导体装置的制造步骤进行例示的图（其1）。
图2B是对第1实施方式的半导体装置的制造步骤进行例示的图（其2）。
图2C是对第1实施方式的半导体装置的制造步骤进行例示的图（其3）。
图2D是对第1实施方式的半导体装置的制造步骤进行例示的图（其4）。
图2E是对第1实施方式的半导体装置的制造步骤进行例示的图（其5）。
图2F是对第1实施方式的半导体装置的制造步骤进行例示的图（其6）。
图2G是对第1实施方式的半导体装置的制造步骤进行例示的图（其7）。
图2H是对第1实施方式的半导体装置的制造步骤进行例示的图（其8）。
图2I是对第1实施方式的半导体装置的制造步骤进行例示的图（其9）。
图2J是对第1实施方式的半导体装置的制造步骤进行例示的图（其10）。
图2K是对第1实施方式的半导体装置的制造步骤进行例示的图（其11）。
图2L是对第1实施方式的半导体装置的制造步骤进行例示的图（其12）。
图2M是对第1实施方式的半导体装置的制造步骤进行例示的图（其13）。
图2N是对第1实施方式的半导体装置的制造步骤进行例示的图（其14）。
图2O是对第1实施方式的半导体装置的制造步骤进行例示的图（其15）。
图2P是对第1实施方式的半导体装置的制造步骤进行例示的图（其16）。
图2Q是对第1实施方式的半导体装置的制造步骤进行例示的图（其17）。
图2R是对第1实施方式的半导体装置的制造步骤进行例示的图（其18）。
图2S是对第1实施方式的半导体装置的制造步骤进行例示的图（其19）。
图2T是对第1实施方式的半导体装置的制造步骤进行例示的图（其20）。
图2U是对第1实施方式的半导体装置的制造步骤进行例示的图（其21）。
图2V是对第1实施方式的半导体装置的制造步骤进行例示的图（其22）。
图2W是对第1实施方式的半导体装置的制造步骤进行例示的图（其23）。
图2X是对第1实施方式的半导体装置的制造步骤进行例示的图（其24）。
图3A是对第1实施方式的变形例1的半导体装置的制造步骤进行例示的图（其1）。
图3B是对第1实施方式的变形例1的半导体装置的制造步骤进行例示的图（其2）。
图3C是对第1实施方式的变形例1的半导体装置的制造步骤进行例示的图（其3）。
图3D是对第1实施方式的变形例1的半导体装置的制造步骤进行例示的图（其4）。
图3E是对第1实施方式的变形例1的半导体装置的制造步骤进行例示的图（其5）。
图3F是对第1实施方式的变形例1的半导体装置的制造步骤进行例示的图（其6）。
图3G是对第1实施方式的变形例1的半导体装置的制造步骤进行例示的图（其7）。
图3H是对第1实施方式的变形例1的半导体装置的制造步骤进行例示的图（其8）。
图3I是对第1实施方式的变形例1的半导体装置的制造步骤进行例示的图（其9）。
图3J是对第1实施方式的变形例1的半导体装置的制造步骤进行例示的图（其10）。
图4A是对第1实施方式的变形例2的半导体装置的制造步骤进行例示的图（其1）。
图4B是对第1实施方式的变形例2的半导体装置的制造步骤进行例示的图（其2）。
图4C是对第1实施方式的变形例2的半导体装置的制造步骤进行例示的图（其3）。
图4D是对第1实施方式的变形例2的半导体装置的制造步骤进行例示的图（其4）。
图5是对第2实施方式的半导体装置进行例示的截面图（其1）。
图6A是对第2实施方式的半导体装置的制造步骤进行例示的图（其1）。
图6B是对第2实施方式的半导体装置的制造步骤进行例示的图（其2）。
图6C是对第2实施方式的半导体装置的制造步骤进行例示的图（其3）。
图6D是对第2实施方式的半导体装置的制造步骤进行例示的图（其4）。
图6E是对第2实施方式的半导体装置的制造步骤进行例示的图（其5）。
图6F是对第2实施方式的半导体装置的制造步骤进行例示的图（其6）。
图6G是对第2实施方式的半导体装置的制造步骤进行例示的图（其7）。
图7是对第2实施方式的半导体装置进行例示的截面图（其2）。
图8是对第3实施方式的半导体装置进行例示的截面图。
图9A是对第3实施方式的半导体装置的制造步骤进行例示的图（其1）。
图9B是对第3实施方式的半导体装置的制造步骤进行例示的图（其2）。
图9C是对第3实施方式的半导体装置的制造步骤进行例示的图（其3）。
图9D是对第3实施方式的半导体装置的制造步骤进行例示的图（其4）。
图9E是对第3实施方式的半导体装置的制造步骤进行例示的图（其5）。
图9F是对第3实施方式的半导体装置的制造步骤进行例示的图（其6）。
图10是对第4实施方式的半导体装置进行例示的截面图。
图11A是对第4实施方式的半导体装置的制造步骤进行例示的图（其1）。
图11B是对第4实施方式的半导体装置的制造步骤进行例示的图（其2）。
图11C是对第4实施方式的半导体装置的制造步骤进行例示的图（其3）。
图11D是对第4实施方式的半导体装置的制造步骤进行例示的图（其4）。
图11E是对第4实施方式的半导体装置的制造步骤进行例示的图（其5）。
图11F是对第4实施方式的半导体装置的制造步骤进行例示的图（其6）。
图12是对第5实施方式的半导体装置进行例示的截面图。
图13A是对第5实施方式的半导体装置的制造步骤进行例示的图（其1）。
图13B是对第5实施方式的半导体装置的制造步骤进行例示的图（其2）。
图13C是对第5实施方式的半导体装置的制造步骤进行例示的图（其3）。
图13D是对第5实施方式的半导体装置的制造步骤进行例示的图（其4）。
图13E是对第5实施方式的半导体装置的制造步骤进行例示的图（其5）。
图13F是对第5实施方式的半导体装置的制造步骤进行例示的图（其6）。
图13G是第5实施方式的半导体装置的制造步骤进行例示的图（其7）。
图13H是对第5实施方式的半导体装置的制造步骤进行例示的图（其8）。
图14是对第6实施方式的半导体装置进行例示的截面图。
图15A是对第7实施方式的半导体装置的制造步骤进行例示的图（其1）。
图15B是对第7实施方式的半导体装置的制造步骤进行例示的图（其2）。
图16是对第8实施方式的半导体装置进行例示的截面图。
图17A是对第8实施方式的半导体装置的制造步骤进行例示的图（其1）。
图17B是对第8实施方式的半导体装置的制造步骤进行例示的图（其2）。
图17C是对第8实施方式的半导体装置的制造步骤进行例示的图（其3）。
图17D是对第8实施方式的半导体装置的制造步骤进行例示的图（其4）。
图17E是对第8实施方式的半导体装置的制造步骤进行例示的图（其5）。
图17F是对第8实施方式的半导体装置的制造步骤进行例示的图（其6）。
图17G是对第8实施方式的半导体装置的制造步骤进行例示的图（其7）。
图17H是对第8实施方式的半导体装置的制造步骤进行例示的图（其8）。
图17I是对第8实施方式的半导体装置的制造步骤进行例示的图（其9）。
图17J是对第8实施方式的半导体装置的制造步骤进行例示的图（其10）。
图17K是对第8实施方式的半导体装置的制造步骤进行例示的图（其11）。
图17L是对第8实施方式的半导体装置的制造步骤进行例示的图（其12）。
图18是对第8实施方式的变形例的半导体装置进行例示的截面图。
图19是对第9实施方式的半导体装置进行例示的一部分的截面图。
图20是对构成第9实施方式的半导体装置的各半导体晶片进行例示的一部分的平面图。
具体实施方式
以下参照附图对实施本发明的方式进行说明。这里需要说明的是，在各附图中存在着对相同的构成部分赋予了相同的符号，并对重复说明进行了省略的情况。
〈第1实施方式〉
[第1实施方式的半导体装置的结构]
首先，对第1实施方式的半导体装置的结构进行说明。图1是对第1实施方式的半导体装置进行例示的截面图。参照图1，第1实施方式的半导体装置100具有半导体晶片110、半导体晶片210、半导体晶片310、及半导体晶片410被积层了的结构。半导体晶片210～半导体晶片410的各侧面分别被作为密封绝缘层的树脂层255～455所密封。
半导体晶片110～410分别具有基板主体120～420、半导体集成电路130～430、及电极垫150～450。基板主体120～420例如由硅等构成。半导体集成电路130～430例如是在硅等中形成了扩散层（图中未示）、绝缘层（图中未示）、导通孔（Via Hole）（图中未示）、及配线层（图中未示）等的集成电路，并被设置在基板主体120～420的一个面侧。下面有时将半导体晶片110～410中设置了半导体集成电路130～430那侧的面称为“主面”或“装置面”。
电极垫150～450介由绝缘层（图中未示）被设置在半导体集成电路130～430上。电极垫150～450与设置在半导体集成电路130～430上的配线层（图中未示）电连接。作为电极垫150～450，例如可使用在Ti层上积层了Au层的积层体等。作为电极垫150～450，也可以使用在Ni层上积层了Au层的积层体、在Ni层上依次积层了Pd层及Au层的积层体、使用以Co、Ta、Ti、TiN等高融点金属取代Ni而构成的层并在该层上积层了Cu层或Al层的积层体或者镶嵌结构（Damascene Structure）状的配线等。
半导体晶片110和半导体晶片210介由作为绝缘层的树脂层160被接合，半导体晶片110的电极垫150和半导体晶片210的电极垫250介由导通孔210y内所填充的金属层380被电连接。半导体晶片210和半导体晶片310介由作为绝缘层的树脂层260被接合，半导体晶片210的电极垫250和半导体晶片310的电极垫350介由导通孔310y内所填充的金属层480被电连接。半导体晶片310和半导体晶片410介由作为绝缘层的树脂层360被接合，半导体晶片310的电极垫350和半导体晶片410的电极垫450介由导通孔410y内所填充的金属层580被电连接。
这里需要说明的是，导通孔是为了在半导体晶片之间（并不限定于上下毗邻的半导体晶片之间）进行连接而设置的连接孔，通过在内部形成金属层或光导波路等，在半导体晶片之间以可传递信号的方式进行连接。下面有时将导通孔内部所形成的金属层或光导波路等称为“连接部”。
半导体晶片410的主面上形成有作为绝缘层的具有开口部460x的阻焊层460，开口部460x内所露出的电极垫450上形成有外部连接端子910。外部连接端子910是为了对半导体装置100和半导体装置100的外部所设置的配线基板等进行电连接而设置的端子，并与电极垫450电连接。作为外部连接端子910，可使用焊料球、Au凸点、及导电膏等。作为外部连接端子910，在使用了焊料球的情况下，作为外部连接端子910的材料，例如，可使用包含Pb的合金、Sn和Cu的合金、Sn和Ag的合金、及、Sn、Ag及Cu的合金等。
[第1实施方式的半导体装置的制造步骤]
接下来，对第1实施方式的半导体装置的制造步骤进行说明。图2A～图2X是对第1实施方式的半导体装置的制造步骤进行例示的图。
首先，在图2A所示的步骤中，对半导体晶圆进行切割，以准备被划片（切割）了的多个半导体晶片210。各半导体晶片210没有被进行薄型化，其厚度例如可为600～800μm左右。
接下来，在图2B所示的步骤中，准备支持体（支撑体）970，并在支持体970的一个面上形成黏接层960。作为支持体970，优选为使用进行对准（Alignment）时光可透过的基板，例如可使用石英玻璃基板等。作为黏接层960，例如可使用在后述的图2G所示的步骤中的加热温度下可软化的黏接剂（在200℃温度左右或其以下的温度下可软化的黏接剂）。黏接层960例如可通过旋涂法形成在支持体970的一个面上。也可以采用贴附膜状黏接剂的方法等以取代旋涂法，将黏接层960形成在支持体970的一个面上。
接下来，在图2C所示的步骤中，介由黏接层960，将各半导体晶片210在面朝下的状态下接合（临时黏接）在支持体970的一个面上。各半导体晶片210被接合在与后述的图2G所示的步骤中被积层的半导体基板111的装置配置（Device Layout）相对应的位置处。
接下来，在图2D所示的步骤中，在黏接层960上形成对各半导体晶片210的至少侧面的一部分进行密封的树脂层255。这里需要说明的是，在该步骤中，只要至在后述的图2E所示的步骤中对各半导体晶片210进行了薄型化后的、各半导体晶片210的侧面被树脂层255完全密封的位置为止，对各半导体晶片210的侧面进行密封即可。但是，也可以通过树脂层255对各半导体晶片210的侧面及背面（没有形成装置那侧的面）进行密封。在此情况下，在后述的图2E所示的步骤中，对各半导体晶片210的侧面的一部分及背面进行密封的树脂层255进行去除，并同时对各半导体晶片210进行薄型化。
作为树脂层255的材料，例如可使用主要成分为苯并环丁烯（BCB）的热硬化性绝缘性树脂。另外，作为树脂层255的材料，也可以使用主要成分为环氧系树脂、丙烯系树脂、聚亚硫胺系树脂的热硬化性绝缘性树脂、及添加了二氧化硅等固形微细粉末的绝缘性复合材料等。树脂层255例如可通过采用旋涂法在黏接层960上涂敷例如主要成分为苯并环丁烯（BCB）的热硬化性绝缘性树脂后、或涂敷后再进行刮除（Squeegee）处理后，加热至预定的硬化温度以使其硬化的方式形成。这里需要说明的是，可以采用气相成长法来取代旋涂法形成树脂层255，也可以采用贴付方法形成膜状的树脂。
这里需要说明的是，树脂层255具有：在进行再配线时提供可实施微影处理的平坦表面的功能、在形成贯穿后述的如图5所示的树脂层255的导通孔时作为加工材料的功能、在划片时对半导体晶片210进行保护以防止被切割机损伤的功能、及确保耐湿性的功能等。
接下来，在图2E所示的步骤中，由研磨机等对树脂层255的不要的部分、及各半导体晶片210的背面侧的基板主体220的一部分进行研削（研磨），以使各半导体晶片210薄型化。据此，各半导体晶片210可被薄型化，同时，薄型化后的各半导体晶片210的侧面还可被树脂层255密封。此时，也可以同时使用干拭擦（Dry Polishing）和湿蚀刻（Wet Etching）等。薄型化后的各半导体晶片210的厚度例如可为1μm～100μm左右。
薄型化后的各半导体晶片210的厚度必须为1μm以上的理由如下。为了不使各半导体晶片210的背面所产生的缺陷和污染等扩散至装置，薄型化后的各半导体晶片210的厚度最低也要为半导体集成电路230的晶体三极管等装置的元件分离深度（图中未示）的5倍以上。这里，半导体集成电路230的晶体三极管等装置的元件分离深度（图中未示）为200～500nm左右。所以，薄型化后的各半导体晶片210的厚度必须为所述元件分离深度的最低值200nm的5倍、即、1μm以上。
接下来，在图2F所示的步骤中，准备半导体基板111，并在半导体基板111的主面111a侧形成树脂层160。半导体基板111具有多个半导体晶片110、及对多个半导体晶片110进行分离的划片区域B。划片区域B中的C示出了切割刀等对半导体基板111进行切割的位置（以下称“切割位置C”）。半导体基板111的直径例如为6英寸（约150mm）、8英寸（约200mm）、或12英寸（约300mm）等。半导体基板111的厚度例如为0.625mm（直径为6英寸时）、0.725mm（直径为8英寸时）、0.775mm（直径为12英寸时）等。
如前所述，各半导体晶片110具有基板主体120、半导体集成电路130、及电极垫150。但是，在此时点，各半导体晶片110还没有被薄型化。关于树脂层160的材料和形成方法，因为可与前述的树脂层255的情况相同，所以省略其说明。
在图2F所示的步骤中，优选为以半导体基板111的背面111b（没有形成装置那侧的面）为基准面，并使树脂层160的面160a（没有与半导体基板111的主面111a相接那侧的面）与该基准面平行。如果树脂层160的面160a与基准面不平行，则因为例如在后述的图2K的步骤中导通孔210y被倾斜地形成，并且金属层380等被形成在被倾斜地形成的导通孔210y中，所以会产生被积层了的半导体晶片之间的连接可靠性下降等的问题。这里需要说明的是，此时的平行是指相对于基准面的树脂层160的面160a的高度H1的不均为1μm以下。因此，在形成了树脂层160之后，优选为设置对高度H1的不均进行确认的步骤。在高度H1的不均为超过了1μm的情况下，优选为设置对树脂层160的面160a进行加工的步骤，以使高度H1的不均为1μm以下。树脂层160的面160a例如可由CMP等进行加工（研削）。
这里需要说明的是，在已经于最下层的半导体基板（第1层）上积层了（n－1）个半导体晶片，并在其最上层的半导体晶片（第n层）上形成了树脂层的情况下，优选为以最下层的半导体基板的背面（没有形成装置那侧的面）为基准面，并使树脂层的上面与该基准面平行。此时的平行是指相对于基准面的树脂层的上面的高度不均为（1×n）μm以下。即，如前所述，在1个半导体基板上形成树脂层的情况下，相对于基准面的树脂层的上面的高度不均优选为1×1＝1μm以下，在例如9个半导体晶片被积层了的半导体基板上形成树脂层的情况下，相对于基准面（最下层的半导体基板的背面）的树脂层的上面的高度不均优选为1×10＝10μm以下。
接下来，在图2G所示的步骤中，在半导体基板111的主面111a上介由树脂层160使图2E所示的结构体上下反转地进行接合。具体而言，首先，对图2E所示的结构体进行配置，以使各半导体晶片210的背面与在半导体基板111的主面111a上所形成的树脂层160相接。各半导体晶片210及半导体基板111上预先形成了用于高精度地进行位置调整的对准标记。可采用现有的方法并以该对准标记为基准，进行图2E所示结构体的相对于半导体基板111的配置。对准的精度例如可为2μm以下。
接下来，在例如以250℃的温度进行了加热的状态下，从支持体970的方向对图2E所示的结构体进行按压，使图2E所示结构体的各半导体晶片210的背面与树脂层160的面160a压着（压接）。据此，树脂层160发生硬化，图2E所示的结构体被接合在半导体基板111的主面111a侧。加热温度可为300℃以上，但优选为200℃以下。其理由在于，如果使用了300℃那样的高温，则热膨张的不同导致产生应力，这将成为随着积层数量的增加半导体基板产生剥离或破裂的原因。
接下来，在图2H所示的步骤中，对图2G所示的黏接层960及支持体970进行去除。因为黏接层960使用了在图2G所示步骤中的加热温度下可发生软化的黏接剂（200℃左右或其以下可发生软化的黏接剂），所以支持体970在使树脂层160发生硬化以将图2E所示结构体接合至半导体基板111的主面111a侧后可被容易地去除。换言之，图2G所示的步骤和图2H所示的步骤是相继的连续步骤。
接下来，在图2I所示的步骤中，以对各半导体晶片210的主面及树脂层255的上面进行覆盖的方式形成感光性光阻膜270。光阻膜270例如可通过将光阻剂涂敷在各半导体晶片210的主面及树脂层255的上面的方式形成。光阻膜270的厚度例如可为10μm左右。
接下来，在图2J所示的步骤中，介由预定的掩膜对图2I所示的光阻膜270进行露光，接下来，对被进行了露光处理的光阻膜270进行显影，据此，在光阻膜270上形成开口部270x。这里需要说明的是，为了便于说明，图2J～图2U仅对图2I所示结构体的一部分（电极垫150及电极垫250的附近）进行了放大并表示。图2J的140及240是图2A～图2I中被省略了的在半导体集成电路130及半导体集成电路230上分别被设置的绝缘层。绝缘层140及240例如由Si3N4或SiO2等构成。绝缘层140及240的厚度例如分别为可实现半导体集成电路130及半导体集成电路230的电绝缘的0.1μm～2.0μm左右。
接下来，在图2K所示的步骤中，在各半导体晶片210上形成导通孔210y。导通孔210y以贯穿与开口部270x相对应的一部分的半导体晶片210（基板主体220、半导体集成电路230、绝缘层240、及电极垫250）及树脂层160，并使半导体基板111的各半导体晶片110的电极垫150露出的方式形成。导通孔210y例如可通过干蚀刻等形成。导通孔210y在平面视图中例如为圆形，其直径 例如可为1μm～30μm左右。但是，导通孔210y的直径 优选为可使纵横比（＝深度D1/直径 ）为0.5以上5以下的值。其理由在于，通过将导通孔210y的直径 设定为可使纵横比（＝深度D1/直径 ）为0.5以上5以下的值，可实现形成导通孔210y时的蚀刻加工速度（生产能力）的提高、及后述的金属层380向导通孔210y埋入时的容易度的提高等。
接下来，在图2L所示的步骤中，对图2K所示的光阻膜270进行去除。接下来，在图2M所示的步骤中，以对绝缘层240的上面、电极垫250的上面和侧面、导通孔210y的壁面、及导通孔210y的底部所露出的电极垫150的上面进行覆盖的方式形成绝缘层280。绝缘层280例如可通过等离子CVD法等形成。作为绝缘层280的材料，例如可使用Si3N4或SiO2等。绝缘层280的厚度例如可为0.1μm～2.0μm。
接下来，在图2N所示的步骤中，对除了导通孔210y的壁面以外的部分的绝缘层280进行去除。绝缘层280的去除例如可通过RIE（Reactive Ion Etching）进行。该步骤是不使用光掩膜仅对绝缘层280的预定部分进行去除的步骤，被称为“自对准处理”。通过自对准处理，可对导通孔210y和电极垫250进行正确的定位。另外，通过采用一部分没有设置电极垫的设计，例如在不存在电极垫之处进行蚀刻，再至下层所设置的不同半导体晶片的电极垫为止进行蚀刻，可以形成深度不同的导通孔。
接下来，在图20所示的步骤中，以对绝缘层240的上面、电极垫250的上面及侧面、绝缘层280的上面及侧面、及导通孔210y的底部所露出的电极垫150的上面进行覆盖的方式形成金属层290。金属层290例如可通过非电解电镀法等形成。金属层290也可以通过例如溅射法、CVD法等形成。作为金属层290，例如可使用在Ti层上积层了Cu层的积层体等。作为金属层290，也可以使用例如在Ta层上积层了Cu层的积层体等。另外，埋入材料可为满足设计规范的导体，可使用取代Cu的W或Al、掺杂多晶硅、碳纳米管等炭素材料、及导电性聚合物中的任一种。另外，在绝缘层具有充分的绝缘性的情况下，可以选用不使用拜耳（Bayer）金属层的埋入配线的组合。
接下来，在图2P所示的步骤中，以对除了导通孔210y的内部以外的金属层290的上面进行覆盖的方式形成感光性光阻膜370。光阻膜370例如可通过将干膜光阻膜贴付在金属层290的上面的方式形成。光阻膜370的厚度例如可为10μm。接下来，在图2Q所示的步骤中，介由预定的掩膜对图2P所示的光阻膜370进行露光，接下来，对被进行了露光处理的光阻膜370进行显影，据此，在光阻膜370上形成开口部370x。开口部370x被形成为使导通孔210y及其周边部的金属层290的上面露出。开口部370x在平面视图中例如为圆形，其直径 例如可为1μm～30μm。
接下来，在图2R所示的步骤中，在图2Q的所示导通孔210y的内部及开口部370x的一部分上形成金属层380。金属层380例如可通过采用将金属层290作为供电层的方法，析出镀膜并使其成长，以对图2Q所示的导通孔210y的内部及开口部370x的一部分进行填充的方式形成。作为构成金属层380的镀膜，例如可使用Cu镀膜。接下来，在图2S所示的步骤中，对图2R所示的光阻膜370进行去除。
接下来，在图2T所示的步骤中，对没有被金属层380所覆盖的部分的金属层290进行去除。金属层290例如可通过湿蚀刻等进行去除。接下来，在图2U所示的步骤中，以对电极垫250及金属层380进行覆盖的方式形成金属层390。金属层390例如可通过采用在绝缘层240上形成对电极垫250及金属层380进行开口的光阻膜，并使电极垫250及金属层380作为供电层的方法，析出镀膜并使其成长以填充开口部，之后，对光阻膜进行去除的方式形成。作为金属层390，例如可使用在Ti层上积层了Au层的积层体等。作为金属层390，例如也可以使用在Ni层上依次积层了Pd层及Au层的积层体、采用由取代Ni的Co、Ta、Ti、iN等高融点金属所构成的层并在该层上积层了Cu层或Al层的积层体或者镶嵌结构状配线等。
接下来，在图2V所示的步骤中，重复进行图2I～图2U所示的步骤，对半导体晶片310及410进行积层。这里，尽管在半导体基板111上进行了3层的半导体晶片210、310、及410的积层，但是，也可以在半导体基板111上进行1层、2层、或4层以上的半导体晶片的积层。另外，在各层上进行积层的半导体晶片可以具有相同的功能，也可以具有不同的功能。
另外，在图2V等中，尽管将半导体晶片210等描绘为相同的形状，但是，并不限定于此。例如，在图2V中，也可以使用形状各异的半导体晶片作为3个半导体晶片210。
接下来，在图2W所示的步骤中，通过现有的方法形成外部连接端子910。在形成外部连接端子910时，例如形成Ni层作为金属层390。然后，在阻焊层460上形成使Ni层露出的开口部460x，之后，在开口部460x内所露出的Ni层上形成外部连接端子910。外部连接端子910是用于对半导体装置100和半导体装置100的外部所设置的配线基板等进行电连接而设置的端子。作为外部连接端子910，可使用焊料球、Au凸点、及导电膏等。在使用焊料球作为外部连接端子910的情况下，作为外部连接端子910的材料，例如可使用包含Pb的合金、Sn及Cu的合金、Sn及Ag的合金、及、Sn、Ag及Cu的合金等。
接下来，在图2X所示的步骤中，使用研磨机等对半导体基板111的背面进行研削，以使半导体基板111薄型化。此时，也可以同时使用干拭擦和湿蚀刻等。薄型化后的半导体基板111的厚度例如可为1μm～100μm左右。
接下来，在图2X所示的步骤之后，通过对图2X所示的结构体在切割位置C处使用切割刀等进行切割、划片，制成图1所示的半导体装置100。这里需要说明的是，也可以适当地设置切割位置C，以具有多个包含半导体晶片的积层体。例如，可以适当地设置切割位置C，以包含具有功能A的半导体晶片的积层体、及具有不同于功能A的功能B的半导体晶片的积层体。此时，包含具有功能A的半导体晶片的积层体的平面形状可以不同于包含具有功能B的半导体晶片的积层体的平面形状。
这样，根据第1实施方式，准备一在主面侧形成了具有半导体集成电路的多个半导体晶片的半导体基板，并在准备好的半导体基板的主面上形成绝缘层。之后，将主面侧具有半导体集成电路的被划片了的半导体晶片，以使背面与所述绝缘层相对并介由所述绝缘层的方式，在半导体基板上所形成了的半导体晶片上进行积层。接下来，形成贯穿被划片了的半导体晶片的导通孔，并对被划片了的半导体晶片的电极垫和半导体基板上所形成了的半导体晶片的电极垫介由导通孔内所填充了的金属层进行电连接。
通过重复进行这样的步骤，可在半导体基板上对多个半导体晶片进行积层，并可在不同层的半导体晶片之间以可传递信号的方式进行连接。其结果为，在半导体晶片之间进行连接时，因为不需要在导通孔内形成凸点的步骤，所以能够提供一种生产率较高，并可降低制造成本的半导体装置的制造方法。
另外，根据第1实施方式，因为采用使形成了半导体集成电路的面和没有形成半导体集成电路的面相对着的方式在半导体晶片之间进行接合，所以仅单纯地重复进行同样的步骤，就可在半导体基板上进行2层以上的半导体晶片的积层，这样，就能够提供一种生产率较高，并可降低制造成本的半导体装置的制造方法。
另外，根据第1实施方式，因为导通孔形成在被薄型化了的半导体晶片上，并且也不需要形成较深的导通孔，所以，不会导致增加导通孔的孔加工和金属填充的时间，也不会导致增加必要的材料，这样，就可以防止半导体装置的制造成本的上升。
另外，根据第1实施方式，因为在使半导体晶片极薄化后再形成导通孔，所以即使导通孔的大小和密度不同，也可以减小导通孔前端部分的直径的变化度，这样，就可以降低电连接时的电阻值的不均并提高可靠性。
另外，根据第1实施方式，因为在半导体基板上对被进行了划片的半导体晶片进行积层，所以可容易对装置大小不同的半导体晶片进行积层。
〈第1实施方式的变形例1〉
第1实施方式的变形例1中示出了将预先进行了薄型化的多个半导体晶片不使用支持体地安装在半导体基板上，并在半导体基板上由树脂层对各半导体晶片的主面及侧面进行了密封的例子。另外，还示出了在被积层的半导体晶片的电极之间采用与第1实施方式不同的方法进行电连接的例子。这里需要说明的是，在第1实施方式的变形例1中，对与已经说明了的实施方式相同的构成部件的说明进行了省略。
图3A～图3J是对第1实施方式的变形例1的半导体装置的制造步骤进行例示的图。
首先，在图3A所示的步骤中，在由研磨机等对半导体晶圆的背面进行研削以使其薄型化后，准备通过切割而被进行了划片的多个半导体晶片210。各半导体晶片210的厚度例如可为1μm～100μm左右。
接下来，在图3B所示的步骤中，与图2F所示步骤同样地，准备在主面111a侧形成了树脂层160的半导体基板111。然后，在半导体基板111的主面111a上介由树脂层160对各半导体晶片210进行接合。具体而言，首先，与图2G所示步骤同样地进行对准并进行配置，以使各半导体晶片210的背面与半导体基板111的主面111a上所形成的树脂层160相接。接下来，与图2G所示步骤同样地进行加热及按压，以使各半导体晶片210的背面和树脂层160的面160a压接。据此，树脂层160发生硬化，各半导体晶片210被接合在半导体基板111的主面111a侧。
接下来，在图3C所示的步骤中，与图2D所示步骤同样地，在树脂层160的面160a上形成对各半导体晶片210的主面及侧面进行密封的树脂层255。接下来，在图3D所示的步骤中，以对树脂层255的上面进行覆盖的方式形成感光性光阻膜270。光阻膜270例如通过将光阻剂涂敷在树脂层255的上面的方式形成。光阻膜270的厚度例如可为10μm左右。
接下来，在图3E所示的步骤中，与图2J所示步骤同样地，在图3D所示光阻膜270上形成开口部，并与图2K所示步骤同样地，在各半导体晶片210上形成导通孔210y。之后，与图2L所示步骤同样地，对图3D所示的光阻膜270进行去除。这里需要说明的是，为了便于说明，图3E～图3J仅对图3D所示结构体的一部分（电极垫150及电极垫250的附近）进行了放大并表示。图3E的140及240是在图3A～图3D中被省略了的、被设置在半导体集成电路130及半导体集成电路230上的绝缘层。
接下来，在图3F所示的步骤中，在图3E所示的树脂层255上形成光阻膜（图中未示）。然后，在光阻膜上形成开口部（图中未示），并在对光阻膜的开口部内所露出的树脂层255进行去除后形成开口部255x。之后，对光阻膜进行去除。通过该步骤，电极垫250可在开口部255x内露出。接下来，在图3G所示的步骤中，与图2M所示步骤同样地形成绝缘层280，并与图2N所示步骤同样地对除了导通孔210y的壁面以外的部分的绝缘层280进行去除。接下来，在图3H所示的步骤中，与图20所示步骤同样地形成金属层290。
接下来，在图3I所示的步骤中，在金属层290上形成金属层385。金属层385例如可通过采用以金属层290为供电层的方法析出镀膜并使其成长的方式形成。作为构成金属层385的镀膜，例如可使用Cu镀膜。接下来，在图3J所示的步骤中，对树脂层255上所形成的金属层290及385进行去除。金属层290及385例如可通过CMP等进行去除。树脂层255的表面和金属层290、385的表面大致同面。
接下来，在图3J所示结构体上形成了树脂层后，重复进行图3A～图3J所示的步骤，对半导体晶片310及410进行积层。然后，与图2W所示步骤同样地采用现有的方法形成了外部连接端子910后，通过采用切割刀等进行切割、划片，制成与图1相对应的半导体装置。这里需要说明的是，也可将图3E～图3J所示的步骤置换为图2J～图2U所示的步骤。
这样，根据第1实施方式的变形例1，除了可实现与第1实施方式同样的效果之外，还可实现如下效果。即，通过将预先进行了薄型化的多个半导体晶片安装在半导体基板上，并在半导体基板上由树脂层对半导体晶片的主面及侧面进行密封，可以不需要使用支持体，这样，就可以简化制造步骤。
〈第1实施方式的变形例2〉
第1实施方式的变形例2中示出了将预先进行了薄型化的多个半导体晶片不使用支持体地安装在半导体基板上，并采用与第1实施方式的变形例1不同的方法在半导体基板上由树脂层对各半导体晶片的侧面进行密封的例子。这里需要说明的是，在第1实施方式的变形例2中，对与已经说明了的实施方式相同的构成部件的说明进行了省略。
图4A～图4D是对第1实施方式的变形例2的半导体装置的制造步骤进行例示的图。
首先，在图4A所示的步骤中，与图2F所示步骤同样地，准备在主面111a侧形成了树脂层160的半导体基板111。然后，在半导体基板111的主面111a上介由树脂层160进行框体部件990的接合。框体部件990例如是在平面形状为圆形的部件上形成了多个开口部990x的部件，开口部990x具有可插入半导体晶片210的开口大小。框体部件990具有与半导体晶片210大致相同的厚度。作为框体部件990，例如可使用硅或玻璃等。
接下来，在进行了与图3A同样的步骤后，在图4B所示的步骤中，在与半导体基板111的主面111a相接合的框体部件990的各开口部990x内介由树脂层160分别进行半导体晶片210的接合。具体而言，首先，与图2G所示步骤同样地进行对准并进行配置，以使各半导体晶片210的背面与半导体基板111的主面111a上所形成的树脂层160相接。接下来，与图2G所示步骤同样地进行加热及按压，以使各半导体晶片210的背面和树脂层160的面160a压接。据此，树脂层160发生硬化，各半导体晶片210被接合在半导体基板111的主面111a侧。另外，在各半导体晶片210的侧面和框体部件990的各开口部990x的侧面之间还形成了平面形状为额缘状的间隙990y。
接下来，在图4C所示的步骤中，在树脂层160的面160a上形成对各半导体晶片210的侧面进行密封的树脂层255。具体而言，例如，使用分配器（Dispenser）等在各间隙990y内进行作为树脂层255的树脂的填充，然后，通过由玻璃等构成的按压部件975对填充了的树脂向半导体基板111侧进行按压，并同时加热至预定的温度以使树脂发生硬化。之后，取下按压部件975。
这里需要说明的是，尽管也可以采用不使用框体部件990地通过分配器等将树脂涂敷至毗邻的半导体晶片210的侧面之间的方法，然而，存在着被涂敷至树脂层160的外缘部的树脂发生滴落，难以形成预期形状的树脂层的可能性。所以，优选为使用框体部件990。但是，也可以使用仅被配置在树脂层160的面160a的外缘部的环状框体部件，以取代具有开口部990x的框体部件990。换言之，也可以使用围绕整个半导体晶片210那样的环状框体部件。
接下来，在图4D所示的步骤中，以对各半导体晶片210的主面、树脂层255的上面、及框体部件990的上面进行覆盖的方式形成感光性光阻膜270。光阻膜270例如通过将光阻剂涂敷在各半导体晶片210的主面、树脂层255的上面、及框体部件990的上面的方式形成。光阻膜270的厚度例如可为10μm左右。
接下来，进行与图3E～图3J同样的步骤，然后，在图3J所示结构体上形成了树脂层后，重复进行图3A～图3J所示的步骤，对半导体晶片310及410进行积层。之后，与图2W所示步骤同样地采用现有的方法形成了外部连接端子910后，使用切割刀等进行切割、划片，据此，制成与图1相对应的半导体装置。这里需要说明的是，也可以将图3E～图3I所示的步骤置换为图2J～图2U所示的步骤。
这样，根据第1实施方式的变形例2，可获得与第1实施方式及第1实施方式的变形例1同样的效果。
〈第2实施方式〉
第2实施方式中示出了在被积层的半导体晶片的电极之间介由树脂层内所形成的连接孔进行电连接的例子。这里需要说明的是，在第2实施方式中，对与已经说明了的实施方式相同的构成部件的说明进行了省略。
[第2实施方式的半导体装置的结构]
首先，对第2实施方式的半导体装置的结构进行说明。图5是对第2实施方式的半导体装置进行例示的截面图。参照图5，第2实施方式的半导体装置100A在除了作为连接孔的导通孔210y以贯穿树脂层255的方式形成，并且，半导体晶片210的电极垫250和半导体晶片110的配线155介由导通孔210y内及树脂层255上所形成的金属层380进行电连接这点之外，与第1实施方式的半导体装置100（图1参照）具有同样的构成。配线155例如由Cu等构成，并与电极垫150电连接。
[第2实施方式的半导体装置的制造步骤]
接下来，对第2实施方式的半导体装置的制造步骤进行说明。图6A～图6G是对第2实施方式的半导体装置的制造步骤进行例示的图。
首先，在进行了与第1实施方式的图2A至图2E同样的步骤后，在图6A所示的步骤中，与图2F所示步骤同样地准备半导体基板111，并在半导体基板111的主面111a侧形成树脂层160。这里需要说明的是，在图6A中，半导体基板111中图示了在图2F中被省略了的配线155，这点与图2F不同。配线155例如由Cu等构成，并与电极垫150电连接。
接下来，在进行了与第1实施方式的图2G至图2I同样的步骤后，在图6B所示的步骤中，介由预定的掩膜对图2I所示的光阻膜270进行露光，接下来，对被进行了露光处理的光阻膜270进行显影，据此，在光阻膜270上形成开口部270x。但是，在图2J所示的步骤中，开口部270x是形成在电极垫250上，然而，在本步骤中，是形成在半导体基板111的配线155上。这里需要说明的是，为了便于说明，图6B～图6G仅对图6A所示结构体的一部分（电极垫150、配线155、及电极垫250的附近）进行了放大并表示。
接下来，在图6C所示的步骤中，与图2K所示步骤同样地，在各半导体晶片210上形成导通孔210y。但是，在本步骤中，通过使半导体基板111的配线155的上面露出的方式形成导通孔210y。之后，与图2L所示步骤同样地，对图6B所示的光阻膜270进行去除。接下来，在图6D所示的步骤中，与图2M所示步骤同样地形成绝缘层280，并与图2N所示步骤同样地，对除了导通孔210y的壁面以外的部分的绝缘层280进行去除。
接下来，在图6E所示的步骤中，与图2O所示步骤同样地形成金属层290。然后，与图2P及图2Q所示步骤同样地形成光阻膜370，该光阻膜370具有开口部370x，该开口部370x使包含导通孔210y及电极垫250的区域露出。接下来，在图6F所示的步骤中，与图2R所示步骤同样地，在图6E所示导通孔210y的内部及开口部370x的一部分上形成金属层380。
接下来，在图6G所示的步骤中，在对图6F所示的光阻膜370进行了去除后，与图2T所示步骤同样地，对没有被金属层380覆盖的一部分金属层290进行去除。然后，与图2U所示步骤同样地，以对金属层380进行覆盖的方式形成金属层390。接下来，进行与图2V～图2X同样的步骤，然后，在切割位置C处使用切割刀等进行切割、划片，据此，制成图5所示的半导体装置100A。
这里需要说明的是，也可以如图7所示的半导体装置100B那样，通过进行与图6B～图6G同样的步骤，在半导体晶片210和半导体晶片310之间、以及、半导体晶片310和半导体晶片410之间分别介由树脂层355及455内所形成的导通孔310y及410y进行电连接。另外，在相同的层内也可以同时存在贯穿半导体晶片的导通孔、及贯穿树脂层的导通孔。
这样，根据第2实施方式，除了可实现与第1实施方式同样的效果之外，还可实现如下效果。即，在被积层了的半导体晶片的电极之间介由树脂层内所形成的导通孔进行电连接，据此，即使在半导体晶片内不能形成导通孔的情况下，也可以绕过半导体晶片与下层的半导体晶片进行电连接，这样，就可以提高配线设计的自由度。
〈第3实施方式〉
[第3实施方式的半导体装置的结构]
首先，对第3实施方式的半导体装置的结构进行说明。图8是对第3实施方式的半导体装置进行例示的截面图。第3实施方式的半导体装置100C在除了对上下毗邻的半导体晶片的金属垫进行连接的导通孔及金属层由1个变为4个这点之外，与第1实施方式的半导体装置100（参照图1）具有同样的构成。
在图8中，210z～410z表示导通孔，380a～580a表示填充导通孔210z～410z的金属层。导通孔及金属层相对于各半导体晶片的1个金属垫被各设置了4个。
这样，通过对1个金属垫设置多个导通孔及金属层，可以提高金属垫之间的连接可靠性。另外，如果在正下面的半导体基板上不设计金属垫，则可对1个以上的下层的半导体基板设置导通孔及金属层。在该方式中，可将相同的电信号或不同的电信号连接至预期的半导体基板。另外，因为导通孔的直径变得很小，所以可以缩短用于设置导通孔及金属层的步骤所需要的时间。这里需要说明的是，针对1个金属垫所设置的导通孔及金属层的数量也可为2个、3个或5个以上。
[第3实施方式的半导体装置的制造步骤]
接下来，对第3实施方式的半导体装置的制造步骤进行说明。图9A～图9F是对第3实施方式的半导体装置的制造步骤进行例示的图。这里需要说明的是，关于与第1实施方式的半导体装置的制造步骤相类似的部分，存在着省略其说明的情况。
首先，进行与图2A～图2I同样的步骤。接下来，在图9A及图9B所示的步骤中，介由预定的掩膜对图2I所示的光阻膜270进行露光，接下来，对被进行了露光处理的光阻膜270进行显影，据此，在光阻膜270内形成开口部270y。图9A是截面图，图9B是平面图。这里需要说明的是，为了便于说明，图9A～图9F仅对图2I所示结构体的一部分（电极垫150及电极垫250的附近）进行了放大并表示。
接下来，在图9C所示的步骤中，在半导体晶片210上形成导通孔210z。导通孔210z通过对与开口部270y相对应的一部分的半导体晶片210（基板主体220、半导体集成电路230、绝缘层240、及电极垫250）及树脂层160进行贯通，并使半导体晶片110的电极垫150露出的方式形成。导通孔210z例如可通过干蚀刻等形成。导通孔210z在平面视图中例如为圆形，其直径 例如可为1μm～10μm。但是，导通孔210z的直径 优选为可使纵横比（＝深度D2/直径 ）为0.5以上5以下的值。通过将导通孔210z的直径 设为可使纵横比（＝深度D2/直径 ）为0.5以上5以下的值，可以提高导通孔210z形成时的蚀刻加工速度（生产能力）、及提高金属层380a的向导通孔210z埋入时的容易度等。
接下来，在图9D所示的步骤中，对图9C所示的光阻膜270进行去除。接下来，进行与图2M～图2S同样的步骤，并如图9E所示，在导通孔210z内填充金属层380a。接下来，在对没有被金属层380a覆盖的一部分的金属层290例如通过湿蚀刻等进行去除后，如图9F所示，通过对电极垫250及金属层380a进行覆盖的方式形成金属层390。金属层390例如可通过在绝缘层240上形成对电极垫250及金属层380a进行开口的光阻膜，并采用以电极垫250及金属层380a为供电层的方法，析出镀膜并使其成长以填充开口部，之后，再对光阻膜进行去除的方式形成。
之后，通过重复进行与第1实施方式同样的步骤，制成图8所示的半导体装置100C。
这样，根据第3实施方式，不仅可获得与第1实施方式同样的效果，还可获得如下效果。即，因为导通孔直径较小，所以可缩短用于设置导通孔及金属层的步骤所需要的时间，并且，通过针对1个金属垫设置多个的导通孔及金属层，可提高金属垫之间的连接可靠性。
〈第4实施方式〉
[第4实施方式的半导体装置的结构]
首先，对第4实施方式的半导体装置的结构进行说明。图10是对第4实施方式的半导体装置进行例示的截面图。第4实施方式的半导体装置100D除了将第3实施方式的半导体装置100C中针对4个导通孔及金属层设置1个金属垫变为针对1个导通孔及金属层设置1个金属垫这点之外与第3实施方式的半导体装置100C具有同样的构成。
在图10中，150a及150b～450a及450b示出了金属垫。金属垫相对于1个导通孔及金属层被各设置1个。
这样，通过针对1个金属垫设置1个导通孔及金属层，在对毗邻的金属垫分配了相同的信号的情况下，可以与第3实施方式同样地提高金属垫之间的连接可靠性。另外，在对毗邻的金属垫分配了不同的信号的情况下，可以提高配线设计的自由度。
[第4实施方式的半导体装置的制造步骤]
接下来，对第4实施方式的半导体装置的制造步骤进行说明。图11A～图11F是对第4实施方式的半导体装置的制造步骤进行例示的图。这里需要说明的是，关于与第1实施方式或第2实施方式的半导体装置的制造步骤类似的部分，存在着省略了其说明的情况。
首先，进行与图2A～图2I同样的步骤。接下来，在图11A及图11B所示的步骤中，介由预定的掩膜对图2I所示的光阻膜270进行露光，接下来，对被进行了露光处理的光阻膜270进行显影，据此，在光阻膜270上形成开口部270y。图11A是截面图，图11B是平面图。这里需要说明的是，为了便于说明，图11A～图11F仅对图2I所示结构体的一部分（电极垫150及电极垫250的附近）进行了放大并表示。
接下来，在图11C所示的步骤中，在半导体晶片210上形成导通孔210z。导通孔210z通过贯穿与开口部270y相对应的一部分的半导体晶片210（基板主体220、半导体集成电路230、绝缘层240、及电极垫250）及树脂层160，并使半导体晶片110的电极垫150a及150b露出的方式形成。导通孔210z例如可通过干蚀刻等形成。导通孔210z在平面视图中例如为圆形，其直径 例如可为1μm～10μm。但是，导通孔210z的直径 优选为可使纵横比（＝深度D2/直径 ）为0.5以上5以下的值。通过将导通孔21z的直径 设为可使纵横比（＝深度D2/直径 ）为0.5以上5以下的值，可以提高导通孔210z形成时的蚀刻加工速度（生成能力）、及提高金属层380b的向导通孔210z埋入时的容易度等。
接下来，在图11D所示的步骤中对图11C所示的光阻膜270进行去除。接下来，进行与图2M～图2S同样的步骤，如图11E所示，在导通孔210z内填充金属层380b。接下来，在对没有被金属层380b覆盖的一部分的金属层290例如通过湿蚀刻等进行去除后，如图11F所示，通过对电极垫250及金属层380b进行覆盖的方式形成金属层390a。金属层390a例如可通过在绝缘层240上形成对电极垫250及金属层380b进行开口的光阻膜，并采用以电极垫250及金属层380b为供电层的方法，析出镀膜并使其成长以填充开口部，之后，对光阻膜进行去除的方式形成。
之后，通过重复进行与第1实施方式同样的步骤，制成图10所示的半导体装置100D。
这样，根据第4实施方式，不仅可实现与第1实施方式同样的效果，还可实现如下效果。即，在对毗邻的金属垫分配了相同的信号的情况下，与第3实施方式同样地可以提高金属垫之间的连接可靠性。另外，在对毗邻的金属垫分配了不同的信号的情况下，可以提高配线设计的自由度。
〈第5实施方式〉
[第5实施方式的半导体装置的结构]
首先，对第5实施方式的半导体装置的结构进行说明。图12是对第5实施方式的半导体装置进行例示的截面图。第5实施方式的半导体装置100E除了将第4实施方式的半导体装置100D中的与所有半导体晶片的所有导通孔相对应的位置都设置金属垫变更为一部分不设置金属垫，并且，由导通孔及金属层对设置了金属垫的半导体晶片进行直接连接这点以外，与第4实施方式的半导体装置100D具有同样的构成。
这样，通过将金属垫仅设置在一部分半导体晶片上，可由导通孔及金属层对不毗邻的半导体晶片进行直接连接，因此，可提高配线设计的自由度。
[第5实施方式的半导体装置的制造步骤]
接下来，对第5实施方式的半导体装置的制造步骤进行说明。图13A～图13H是对第5实施方式的半导体装置的制造步骤进行例示的图。这里需要说明的是，关于与第1实施方式至第4实施方式的半导体装置的制造步骤类似的部分，存在着省略其说明的情况。
首先，进行与图2A～图2I同样的步骤。接下来，在图13A及图13B所示的步骤中，介由预定的掩膜对图2I所示的光阻膜270进行露光，接下来，对被进行了露光处理的光阻膜270进行显影，据此，在光阻膜270上形成开口部270z。图13A是截面图，图13B是平面图。这里需要说明的是，为了便于说明，图13A～图13H仅对图2I所示结构体的一部分（电极垫150及电极垫250b的附近）进行了放大并表示。
接下来，在图13C所示的步骤中，在半导体晶片210上形成导通孔210z。导通孔210z通过贯穿与开口部270z相对应的一部分的半导体晶片210（基板主体220、半导体集成电路230、绝缘层240、及电极垫250b）及树脂层160，并使半导体晶片110的电极垫150a及150b露出的方式形成。导通孔210z例如可通过干蚀刻等形成。导通孔210z在平面视图中例如为圆形，其直径 例如可为1μm～10μm。但是，导通孔210z的直径 优选为可使纵横比（＝深度D2/直径 ）为0.5以上5以下的值。通过将导通孔210z的直径 设为可使纵横比（＝深度D2/直径 ）为0.5以上5以下的值，可以提高导通孔210z形成时的蚀刻加工速度（生成能力）、及提高金属层380b的向导通孔210z埋入时的容易度等。
接下来，在图13D所示的步骤中，对图13C所示的光阻膜270进行去除。接下来，在进行了与图2M～图2N同样的步骤后，如图13E所示，通过对绝缘层240的上面、电极垫250b的上面及侧面、绝缘层280的上面、导通孔210z的底部所露出的电极垫150a及150b的上面进行覆盖的方式形成金属层290。金属层290例如可通过无电解电镀法等形成。金属层290例如也可采用溅射法、CVD法等形成。作为金属层290，例如可以使用在Ti层上积层了Cu层的积层体等。作为金属层290，例如也可以使用在Ta层上积层了Cu层的积层体等。另外，埋入材料只要是可满足设计规范的导体即可，可使用取代Cu的W或Al、掺杂多晶硅、碳纳米管等炭素材料、及导电性聚合物的任一种。另外，在绝缘层具有充分的绝缘性的情况下，可以选用不使用拜耳（Bayer）金属层的埋入配线的组合。
接下来，在图13F所示的步骤中，以对除了导通孔210z的内部以外的金属层290的上面进行覆盖的方
半导体装置的制造方法专利购买费用说明
Q：办理专利转让的流程及所需资料
A：专利权人变更需要办理著录项目变更手续，有代理机构的，变更手续应当由代理机构办理。
1：专利变更应当使用专利局统一制作的“著录项目变更申报书”提出。
2：按规定缴纳著录项目变更手续费。
3：同时提交相关证明文件原件。
4：专利权转移的，变更后的专利权人委托新专利代理机构的，应当提交变更后的全体专利申请人签字或者盖章的委托书。
Q:专利著录项目变更费用如何缴交
A：（1）直接到国家知识产权局受理大厅收费窗口缴纳,（2）通过代办处缴纳，（3）通过邮局或者银行汇款,更多缴纳方式
Q：专利转让变更，多久能出结果
A：著录项目变更请求书递交后，一般1-2个月左右就会收到通知，国家知识产权局会下达《转让手续合格通知书》。
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